时间:2024-07-27 来源:网络搜集 关于我们 0
大量开源 FPGA IP 核设计,提供仿真和上板部署教程,纯Verilog实现(可在各厂家 FPGA 上移植),涉及 USB、DDR、RISC-V SoC、CAN、SD、UART、无刷电机、无损压缩、视频编码、图像编码、SHA 等,拿来就学,拿来就用!
感谢群友 and 作者 WangXuan95 的不懈编码、开源分享。
GitHub: https://github.com/WangXuan95?tab=repositories&sort=stargazers
Gitee: https://gitee.com/wangxuan95/projects
GitHub同步更新到Gitee,如果Github访问慢,可以在Gitee里找别忘了点star支持作者(WangXuan95)!
【接口/协议控制类】
● FPGA USB1.1设备端控制器
https://github.com/WangXuan95/FPGA-USB-Device
仅用FPGA的普通IO,不依赖额外芯片提供6个设备例子:USB串口、USB双串口、USB UVC摄像头、USB麦克风/扬声器、USB键盘、U盘如果你熟悉USB描述符配置,还可以用它实现更多设备● FPGA FT232H/FT600 USB芯片控制器https://github.com/WangXuan95/FPGA-ftdi245fifo
控制FT232H或FT600芯片实现USB2.0或USB3.0的高速通信● FPGA DDR1-SDRAM控制器
https://github.com/WangXuan95/FPGA-DDR-SDRAM
使用普通IO驱动DDR1芯片(类似SDR-SDRAM),不要求FPGA具有DDR控制器DDR1与DDR2/DDR3时序类似,因此可帮助你学习DDR2/DDR3时序● FPGA CAN2.0总线控制器
https://github.com/WangXuan95/FPGA-CAN
简单的流式数据收发接口可配置波特率、本地ID、接收ID过滤器● FPGA SD卡读控制器
https://github.com/WangXuan95/FPGA-SDcard-Reader
可自动区分并读取三种卡:SDv1, SDv2, SDHCv2可识别SD卡中的FAT16或FAT32文件系统,读取特定文件名的文件● FPGA UART控制器
https://github.com/WangXuan95/Verilog-UART
可配置收发FIFO位宽和深度可配置UART波特率、校验位、停止位凑分数分频:尽量保证波特率精确【计算类】
● FPGA Gzip无损数据压缩器
https://github.com/WangXuan95/FPGA-Gzip-compressor
输入数据流,输出Gzip压缩流 (Gzip 就是 .gz 压缩文件的格式)Xilinx Artix7 上占 8.4kLUT,性能 128MB/s● FPGA LZMA无损数据压缩器
https://github.com/WangXuan95/FPGA-LZMA-compressor
输入数据流,输出LZMA压缩流 (LZMA 就是 .xz , .7z 压缩文件的格式)Xilinx Artix7 上占 2.4kLUT,性能平均 10MB/s● FPGA MPEG2有损视频编码器
https://github.com/WangXuan95/FPGA-MPEG2-encoder
支持彩色视频压缩 (YUV420)输入视频像素,输出MPEG2压缩流Xilinx Kintex7 上占 130kLUT,性能 1080p 120fps● FPGA JPEG-LS无损图像编码器
https://github.com/WangXuan95/FPGA-JPEG-LS-encoder
支持8-bit灰度图像压缩输入图像像素,输出JPEG-LS压缩流压缩率高于其它常见无损图像压缩标准 (PNG, JPEG2000, WEBP等)Xilinx Artix7 上占 2.5kLUT,性能 1080p 16fps● FPGA PNG图像解码器
https://github.com/WangXuan95/FPGA-PNG-decoder
输入PNG压缩流,输出原始像素 (支持灰度, 灰度透明, RGB, RGBA)● FPGA计算 SHA-1、SHA-256、SHA-512
https://github.com/WangXuan95/Verilog-SHA-Family
输入数据流,输出SHA值【系统/应用类】
● FPGA FOC无刷电机控制器
https://github.com/WangXuan95/FPGA-FOC
实现FOC的完整电流环:电流采样、角度传感器采样、clark/park变换、PID、SVPWM可以通过module接口控制电机电流(力矩)修改后可以实现很高的控制频率 (高于基于MCU的FOC)● FPGA RiscV SoC
https://github.com/WangXuan95/USTC-RVSoC
CPU为RV32I指令集,五段流水线架构包括总线和外设,外设有:存储器、VGA视频、UART调试器上位机(电脑)可以通过UART调试器在线烧写指令流、查看内存数据【教程类】
● Xilinx FPGA PCIe XDMA基础教程
https://github.com/WangXuan95/Xilinx-FPGA-PCIe-XDMA-Tutorial
介绍PCIe XDMA IP核的两种使用方式:传统Verilog开发方式和BlockDesign方式● Vivado+PetaLinux 系统搭建教程https://github.com/WangXuan95/ZedBoard-Tutorial
介绍ZYNQ的PS/PS架构:PS/PL交互、MIO和EMIO的区别、三种使用外设的方式如何用Vivado BlockDesign搭建系统如何用PetaLinux生成Linux启动镜像;如何从SD卡或SPI-flash启动Linux如何编写C语言运行在Linux上,调用GPIO和Central-DMA外设第一手的FPGA、数字IC、通信、嵌入式、春招消息:FPGA探索者往期推荐
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